Explorando a Assimetria do Dimensionamento de Transistores CMOS em Portas Complexas
DOI:
https://doi.org/10.5902/2448190485304Schlagworte:
Engenharia de Computação, Dimensionamento, CMOSAbstract
Para projetar portas lógicas com eficiência, é crucial dimensionar os transistores adequadamente, buscando otimizar área, atraso de propagação e consumo de potência. Para dimensionar os transistores, existem na literatura técnicas amplamente utilizadas, contudo, acredita-se que um modelo alternativo de dimensionamento possa oferecer melhores resultados para as portas complexas. Neste contexto, o presente trabalho explorou um dimensionamento assimétrico de transistores em portas complexas, resultando em ganhos no atraso de propagação em portas lógicas com grandes cargas de saída.
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Böhlke, M. S. (2021). Adaptação ao logical effort: Mantendo a simplicidade e reduzindo o consumo em portas complexas. Trabalho de Conclusão de Curso. Universidade Federal de Pelotas.
Callegaro, V., Marques, F. d. S., Klock, C. E., da Rosa Jr, L. S., Ribas, R. P., and Reis, A. I. (2010). Switchcraft: a framework for transistor network design. In Proceedings of the 23rd symposium on Integrated circuits and system design, pages 49–53.
Kessler, H., Böhlke, M., da Rosa, L. S., Porto, M., and Camargo, V. V. (2022a). Calibration of logical effort transistor sizing for on-the-fly low-power supergate design. In 2022 IEEE 13th Latin America Symposium on Circuits and System (LASCAS), pages 1–4. IEEE.
Kessler, H., Porto, M., Da Rosa, L., and Camargo, V. V. (2022b). Standard cell and supergates designs: An electrical comparison on 4-input logic functions. In 2022 IEEE International Symposium on Circuits and Systems (ISCAS), pages 1744–1748. IEEE.
Kessler, H. C. (2022). Static cmos complex gates: electrical investigation of design strategies. Master’s thesis, Universidade Federal de Pelotas.
Kofuji, S. T., Zuffo, J. A., and Soares, J. N. (1990). Circuitos integrados cmos. Disciplina de Eletrônica Experimental.
Marques, F. S., Rosa Jr, L., Ribas, R. P., Sapatnekar, S. S., and Reis, A. I. (2007). Dag based library-free technology mapping. In Proceedings of the 17th ACM Great Lakes symposium on VLSI, pages 293–298.
Moore, G. (1965). Moore’s law. Electronics Magazine, 38(8):114.
Ricci, A., De Munari, I., and Ciampolini, P. (2007). An evolutionary approach for standard-cell library reduction. In Proceedings of the 17th ACM Great Lakes symposium on VLSI, pages 305–310.
Sutherland, I., Sproull, R. F., and Harris, D. (1999). Logical effort: designing fast CMOS circuits. Morgan Kaufmann.
Tseng, I., Postula, A., and Jozwiak, L. (2005). Symbolic extraction for estimating analog layout parasitics in layout-aware synthesis.
Weste, N. and Harris, D. (2011). CMOS VLSI Design: A Circuits and Systems Perspective. Pearson Education.
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